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標(biāo)簽:Cadence 第2頁

成熟的PCIe 6.0 IP可極大降低復(fù)雜系統(tǒng)開發(fā)難度-DOIT-數(shù)據(jù)產(chǎn)業(yè)媒體與服務(wù)平臺(tái)

成熟的PCIe 6.0 IP可極大降低復(fù)雜系統(tǒng)開發(fā)難度

從正式發(fā)布至今,PCI Express(PCIe)發(fā)展迅速,在現(xiàn)代數(shù)字世界中無處不在,已經(jīng)成為高性能計(jì)算、人工智能/機(jī)器學(xué)習(xí)(ML)加速器、網(wǎng)絡(luò)適配器和固態(tài)存儲(chǔ)等應(yīng)用不可或缺的一項(xiàng)技術(shù)。不僅如此,PCIe技術(shù)近期在速度和延遲方面取得的突破讓...

Cadence推出全新Tensilica FloatingPoint DSP系列,為廣泛的計(jì)算密集型應(yīng)用提供可擴(kuò)展性能

低能耗DSP IP可優(yōu)化功耗、性能和面積,為移動(dòng)、汽車、消費(fèi)電子和超大規(guī)模計(jì)算市場(chǎng)產(chǎn)品減小高達(dá)40%的面積。 2021年6月18日,楷登電子(美國Cadence公司,NASDAQ:CDNS)發(fā)布Cadence Tensilica Float...

Xilinx、Arm、Cadence和臺(tái)積公司共同宣布全球首款采用7納米工藝的CCIX測(cè)試芯片

9月11日,中國上?!愳`思、Arm、Cadence和臺(tái)積公司今日宣布一項(xiàng)合作,將共同構(gòu)建首款基于臺(tái)積7納米FinFET工藝的支持芯片間緩存一致性(CCIX)的加速器測(cè)試芯片,并計(jì)劃在2018年交付。這一測(cè)試芯片旨在從硅芯片層面證明CCIX...

李 衛(wèi)忠李 衛(wèi)忠業(yè)界動(dòng)態(tài)